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Chapter 1: ML501 Evaluation Platform
R
1. Virtex-5 FPGA
A Xilinx Virtex-5 FPGA, XC5VLX50-1FFG676, is installed on the Evaluation Platform (the
board).
Configuration
The board supports configuration in all modes: JTAG, Master Serial, Slave Serial, Master
SelectMAP, Slave SelectMAP, Byte-wide Peripheral Interface (BPI) Up, BPI Down, and SPI
modes. See the “Configuration Options,” page 36 section for more information.
I/O Voltage Rails
The FPGA has 14 banks. The I/O voltage applied to each bank is summarized in Table 1-1 .
Table 1-1:
I/O Voltage Rail of FPGA Banks
FPGA Bank
0
1
2
3
4
11
12
13
14
15
16
17
18
21
I/O Voltage Rail
3.3V
3.3V
3.3V
2.5V
3.3V
User selectable as 2.5V or 3.3V using jumper J20
3.3V
User selectable as 2.5V or 3.3V using jumper J20
1.8V
3.3V
1.8V
3.3V
1.8V
1.8V
14
www.xilinx.com
ML501 Evaluation Platform
UG226 (v1.4) August 24, 2009
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